gnu-make

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Désactiver les règles et les variables intégrées à l'intérieur du fichier make

Je souhaite désactiver les règles intégrées et les variables en passant le -r and -R options à GNU make, à partir du fichier make. D'autres solutions qui me permettent de le faire implicitement et de

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Dépend du fichier make lui-même

Dans le cas où un Makefile lui-même est modifié, un pari sûr serait de considérer toutes les cibles périmées. Existe-t-il une manière intelligente d'ajouter cette dépendance? Y a-t-il des alternatives

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VERBOSE = oui option makefile sur gnu make sous cygwin ne fonctionne pas pour moi

J'utilise gnumake version GNU Make 3.81 sous cygwin sur windows. La version de Cygwin est CYGWIN_NT-6.1-WOW64 1.7.7 (0.230/5/3) 2010-08-31 09:58 i686 Cygwin Dans mon makefile utilisé pour construire l

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Est-il possible de tester si une définition C est déclarée dans un Makefile gnu?

Je souhaite inclure différents répertoires dans ma construction en fonction de la déclaration d'une #define dans un fichier .h de mon projet. Est-ce possible ou est-ce que je vais complètement à tort?

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Comment puis-je voir les invocations provoquées par l'exécution de fichiers make générés par cmake?

Comment puis-je voir les invocations g ++ provoquées par l'exécution de make? Je génère mon makefile en utilisant cmake, donc c'est assez grand. Utilisation verbeux = 1, CMake cache encore les g ++ in

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Simple question à propos de Makefile

J'ai un Makefile suivant pour tiobench. Je l'ai écrit. Le problème est, quand je fais make all, cela ne me laisse pas dans le répertoire d'installation comme il se doit. Pourquoi ? # Makefile for tiot

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Alternatives pour gmake?

J'ai un fichier programme C++ avec deux fonctions. Si je change seul la première fonction, pourquoi les deux devraient-ils être recompilés? Existe-t-il un système de compilation qui recompile le premi

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dépendances dans Makefile

Supposons que j'ai un Makefile: all: $(BINARY) $(BINARY): $(OBJS) $(DEBUG_OBJS) #Link objects here $(OBJS): headers #Compile code into objects without debug option $(DEBUG_OBJS): heade

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makefile mettre objs dans le répertoire séparé

Pourquoi $(OBJDIR)\%.o:$(SRDDIR)\%.s $(GCC) -c -g -I$(SRCDIR) $(ASFLAGS) $< -o [email protected] $(OBJDIR)\%.o:$(SRDDIR)\%.c $(GCC) -c -g -I$(SRCDIR) $(CFLAGS) $< -o [email protected] do

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Makefile pour placer les fichiers objets des fichiers source différents répertoires dans un seul répertoire séparé?

J'utilise UnitTest ++ pour me permettre de créer des tests unitaires pour du code C++ (qui devrait s'appuyer sur Linux ou Mac OS X). J'ai une structure de répertoires comme ceci: src - Foo.cpp - Bar